[IP Name]

ブロック図

Solution Type: IP Core

End Market: Broadcast, Computer & Storage, Consumer, Industrial, Medical, Military, Test & Measurement

Evaluation Method: Source Code

Technology: Basic Functions: Simulation, Debug and Verification

Arria Series: Arria 10, Arria V, Arria 10 SoC, Arria V SoC

Cyclone Series: Cyclone IV, Cyclone V, Cyclone V SoC

Stratix Series: Stratix IV, Stratix V

概要

IP Lock is an FPGA logic security system which uses very reliable AES encryption technology. IP properties in the FPGA are protected from illegal copy by including IP Lock in the FPGA and connecting it with encryption controller chip.

機能

    デバイス使用量および性能

    N/A

    スタートガイド

    Step1: Prepare SOIC-8 pattern for security chip on your board >> Step2: When you need FPGA logic protection, purchase IPLock product >> Step3: Compile your FPGA logic with IPLock core >> Step4: Put IPLock security chip on FPGA board >> Step5: Complete IP core protection!

    IP に関する詳細

    概要
    リリース時期2016
    サポートされる Quartus の最新バージョン15.1
    顧客利用状況
    1以上の顧客においてプロダクション品で実装済みY
    提供される内容

    IP 製品には以下が含まれます。

    • デザインファイル (暗号化されたソースコードもしくはシンセシス後のネットリスト)
    • ModelSim Altera edition 用のシミュレーション・モデル
    • タイミングおよびデザイン例
    • テストベンチもしくはデザイン例
    • 変更履歴付き資料
    • Readme ファイル
    Y
    その他の提供物
    SOIC-8 encryption chip, software
    ユーザーが IP のコンフィギュレーション可能なパラメタライズ化された GUIN
    OpenCore Plus サポートの利用N
    ソース言語
    VHDL
    テストベンチ言語VHDL
    提供されるソフトウェア・ドライバーY
    ドライバー OS サポートWindows
    実装情報
    ユーザー・インタフェースOther: 2.5-3.3V IO
    IP-XACT メタデータN
    検証
    シミュレーション・サポートN/A
    ハードウェアの検証Y. Altera Board Name Cyclone III
    業界標準準拠テストの実施
    N
    今後のテストの実施予定N
    相互接続性
    相互接続性テストを実施済み
    N
    相互接続性レポートN

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