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以下を含む、誘導管制、航空電子、インテリジェンス、レーダー、電子戦、および宇宙システムのアーキテクチャーを実装するための最新のデザインアプローチと技法をご紹介します。


  • 新しい IP (Intellectual Property) とリファレンス・デザインのプレビュー
  • 多くの防衛機器アプリケーションに関するホワイトペーパーへの優先アクセス
  • 新しい FPGA & SoC のロードマップと計画
  • システムデザインの課題に独自のアプローチで取り組むパートナーと業界同業者のプロファイル
  • 招待者限定のセミナーおよびシンポジウム

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防衛機器オンラインセミナー & ビデオ

SoC FPGA の誤り訂正コードによる DRAM のソフトエラー低減 (15 分)

このオンラインセミナーでは、SoC FPGA に搭載される誤り訂正コード (ECC) 機能によってソフトエラーを緩和することで組込みシステムのエラー回復機能を改善できる理由を解説します。

Hans Spanjaart (Sr. Technical Marketing Manager)(英語版)

Implementing FPGA Design with OpenCL – A Future Look (15 分)

このオンラインセミナーでは、FPGA に関する新しいテクノロジーである OpenCL を紹介します。市場ドライバーとエンベデッド技術のイネーブラー、FPGA をハードウェア・アクセラレーターとして使用する利点、OpenCL* が FPGA ベースのデザイン環境にどう適応するかについて解説します。

Jordon Inkeles (Sr. Manager, Software and DSP)(英語版)

FPGA と IP コアで実現するビデオデザイン設計期間の短縮 (18 分)

このオンラインセミナーでは、カスタマイズ可能なソリューションを提供し、迅速な IP 統合を可能にする FPGA が、シンプルなフォーマット変換あるいは先進的なデジタルビデオ処理を必要とする場合でも、迅速なビデオデザインを可能にすることを紹介します。

Richard Yang (Sr. Product Marketing Engineer)

Enhance Your Productivity with Faster Design Compile Times (18分)

FPGA デザイン・ソフトウェアを選ぶ際は、生産性における重要な利点としてコンパイル時間を考慮に入れるべきです。このオンラインセミナーでは、インテル® Quartus® Prime 開発ソフトウェアがどのようにしてコンパイル時間を競合製品の 1/2~1/3 に短縮するかを解説します。

Richard Yang (Product Marketing Engineer)(英語版)

Lower Power and Boost System Bandwidth on 28-nm FPGAs (40分)

ハイエンド・システム・デザインの帯域幅および消費電力の課題に対処する Stratix® V FPGA の主なイノベーションを紹介します。Embedded HardCopy Block、電力効率に優れた 28 Gbps トランシーバー、ソフトウェアによる消費電力最適化は、帯域幅、消費電力、およびコスト要件のバランスに役立つ機能のほんの数例にすぎません。

Frank Yazbeck (PSenior Technical Marketing Staffr)(英語版)

Designing an IP Camera with a Single, Low-Cost FPGA (20分)

このオンラインセミナーでは、FPGA を使用してネットワーク・カメラ用のシングルチップ・プラットフォームを構築する方法を紹介します。WDR (ワイド・ダイナミック・レンジ) CMOS センサーの画像処理に対応したシリコンおよび IP (Intellectual Property) を含む完全なネットワーク・カメラ・ソリューションについて解説します。

Judd Heape (Sr. Strategic Marketing Manager, Industrial Business Unit)(英語版)

Partitioning FPGA Designs for Redundancy and Information Security (20分)

耐障害性、冗長性、および情報セキュリティーが要求されるデザインのアップタイムと信頼性を確保するにはどうすればよいでしょうか。このオンラインセミナーでは、モーター制御およびソフトウェア無線 (SDR) アプリケーションを例にとって、FPGA を使用すれば重要設計要素をパーティションで区切って分離できることを示します。

Tom Schulte (Sr. Marketing Manager)(英語版)

Rapid Military Sensor DSP Design with FPGAs (23分)

DSP Builder for インテル® FPGA のアドバンスト・ブロックセットを使用して、大規模デザインの性能を最適化すると同時にデザインのイタレーションを削減する方法を紹介します。大規模 FPGA によるセンサー (レーダー) フロントエンド・デザインを例にとって、DSP Builder for インテル® FPGA がデザインプロセスの簡素化と高速化をどう実現するかを解説します。

Michael Parker (Senior DSP Technical Marketing Manager)(英語版)