インテル® Stratix® 10 FPGA デモビデオ

現在出荷中のインテル® Stratix® 10 FPGA の主要機能を紹介するデモビデオをご覧ください。

28G トランシーバー

このビデオでは、インテル® Stratix® 10 FPGA の独自のトランシーバー・アーキテクチャーを紹介します。インテルの EMIB テクノロジーにより接続され、バックプレーンで28Gbpsの動作が可能な H タイル・トランシーバーをご覧ください。

インテル® HyperFlex™ FPGA アーキテクチャー

インテル® Stratix® 10 デバイスのインテル® HyperFlex™ FPGA アーキテクチャーでは、2 倍の fMAX 性能1を提供します。このビデオでは、元のデザインと最適化したデザインを並べて比較します。

PCIe* Gen3 - DDR4間 DMA転送

インテル® Stratix® 10 デバイスは、PCIe* とメモリー・コントローラーのハード IP ブロックを搭載しています。Avalon Memory Mapped 機能 + Direct Memory Access (DMA) 機能と組み合わせることで、高性能のリファレンス・デザインを作成できます。

その他のインテル® Stratix® 10 FPGA ビデオ

インテル® Stratix® 10 TX デバイスの次世代デュアルモード・トランシーバー・テクノロジーのデモをご覧ください。56 Gbps PAM4 および 30 Gbps NRZ 変調が可能です。

1 分強のビデオで、従来のメモリー・アーキテクチャーでは対応できない理由を説明します。

エッジからバックエンドに至る 3 分間のビデオツアーでは、IoT がデータ処理に与えている影響と、インテル® Stratix® 10 FPGA などの FPGA が将来的な処理ニーズを満たすうえで果たす極めて重要な役割を紹介します。

詳細情報

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1 インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション 16.1 アーリーベータ版を使用して、Stratix® V FPGA とインテル® Stratix® 10 FPGA を比較。コア・ファブリック内の分散レジスターに関するインテル® Stratix® 10 FPGA アーキテクチャーの強化を利用するために、Hyper-Retiming、Hyper-Pipelining、Hyper-Optimization の 3 ステップの最適化プロセスを使用して Stratix® V FPGA デザインの最適化を行いました。デザインの分析には、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションの Fast Forward Compile 性能調査ツールを使用しました。詳細については、インテル® HyperFlex™ FPGA アーキテクチャーの概要に関するホワイトペーパー wp-01220-hyperflex-architecture-fpga-socs.pdf (英語) を参照してください。実際にユーザーが達成できる性能は、適用されるデザイン最適化のレベルによって異なります。テストは、特定システムでの特定テストにおけるコンポーネントのパフォーマンスを測定しています。ハードウェア、ソフトウェア、システム構成などの違いにより、実際の性能は掲載された性能テストや評価とは異なる場合があります。購入を検討される場合は、ほかの情報も参考にして、パフォーマンスを総合的に評価することをお勧めします。性能やベンチマーク結果について、さらに詳しい情報をお知りになりたい場合は、http://www.intel.com/benchmarks/ (英語) を参照してください。