TimeQuest タイミング・アナライザでの回路の制約およびタイミング解析結果のレポート用に様々なテクニックを紹介します。
制約
ここでは、様々なデザイン例を想定した TimeQuest タイミング・アナライザでの制約ファイル（SDC）の記述方法を紹介します。
基本的な SDC の記述例
デザイン内のクロック、入力パス、および出力パスに対して制約を与える、最も基本的な SDC の記述を紹介します。
マルチサイクル・パスの指定
SDC でのマルチサイクル・パスの指定方法を紹介します。 比較的単純な回路を使って、マルチサイクル・パスの指定を 2 とした場合の説明をします。
ジェネレーテッド・クロックに対する制約
デザイン内のジェネレーテッド・クロックに対して制約を与える方法を紹介します。 この例では、2 分周クロック、およびフェーズロック・ループ（PLL）を使用したジェネレーテッド・クロックに対する SDC の記述例を紹介します。
中央揃えのソースシンクロナス出力
このデザイン例では、中央揃えのソースシンクロナス出力バスの制約方法を紹介します。
エッジが揃えられたソースシンクロナス出力
このデザイン例では、エッジが揃えられたソースシンクロナス出力バスの制約方法を紹介します。
中央揃えのソースシンクロナス入力
このデザイン例では、中央揃えのソースシンクロナス入力バスの制約方法を紹介します。
エッジが揃えられたソースシンクロナス入力
このデザイン例では、エッジが揃えられたソースシンクロナス入力バスの制約方法を紹介します。
マルチプレクスされたクロックに対するSDC の記述例
この例は、デザイン内のマルチプレクスされたクロックに対する SDC の制約記述例を紹介します。
マックス・スキューに対する制約
この例は、クロック出力ポートとオフチップでドライブするデータ・バスのビット間のスキューに対する SDC の制約記述例を紹介します。
基本的なソース・シンクロナス出力
この例は、単純なソース同期出力に対して、ジェネレーテッド・クロック、およびアルテラ固有の -reference_pin オプションの 2 つを使用してタイミング制約を与える方法を紹介します。
クロック・イネーブル・マルチサイクル
この例は、レジスタのクロック・イネーブル・ピンをフィードするレジスタからどのようにマルチサイクルの例外を適用するかについて紹介します。
複数の動作状況のレポート
この例は、Tcl スクリプトを使ったマルチコーナー解析の実行の仕方について紹介します。
レポート機能
ここでは、カスタマイズした様々なレポート方法について紹介します。
カスタム・タイミング・レポート・スクリプト
このデザイン例は、Quartus® II ソフトウェア・コンパイル・レポートでコンパイル時にカスタム・レポートを生成するレポートのカスタマイズを行う際の Tcl スクリプト・ファイルの使用方法を解説します。
複数動作条件のレポート
このデザイン例は、Tcl スクリプトを使ったデザインのマルチコーナー解析を実行する方法について紹介します。
レジスタ間のパス・レポート
このデザイン例は、レジスタ間のパス・レポートを生成する方法について紹介します。
ポイント間の遅延レポート
このデザイン例は、ポイント間のパスの遅延をレポートする方法について紹介します。
制約条件が与えられていないパス・レポート
このデザイン例は、制約条件が与えられていないパス・レポートを生成する方法について紹介します。
ネット・タイミング・レポート
このデザイン例は、ネット・タイミング・レポートを生成する方法について紹介します。
障害があるクロック解析レポート
このデザイン例は、すべての動作条件にて障害があるクロックのみの解析をレポートする方法について紹介します。
スクリプティング、エンティティおよびインスタンス名
このデザイン例は、get_registers、get_pins、get_cells を使用するカスタム・スクリプトのエンティティ名の扱いについて紹介します。
ロジック・レベルのレポート
このデザイン例は、パス・セット用に、様々なレベルのロジック数を表示するカスタム・レポートを作成する方法について紹介します。
デザイン例の免責条項
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