エンベデッド・トランシーバを搭載した HardCopy® IV ASIC と Stratix® IV FPGA (GX および GT) は、ハイエンド・アプリケーションに革新的なシステム帯域幅および消費電力効率を提供し、妥協のない技術革新を実現します。これらのトランシーバは、40nm テクノロジーをベースにしており、バックプレーン・アプリケーションおよびチップ間アプリケーションに対して優れたジッタ性能とシグナル・インテグリティを実現する多くの機能を備えています。 HardCopyIV ASIC と Stratix IV FPGA (GX および GT) の トランシーバは、前世代のアルテラ・デバイスの トランシーバの成功の基に構築されています。これらのトランシーバには、複数のデジタル・ブロックを搭載しており、これらのデジタル・ブロックをコンフィギュレーションしてプロトコルの実装を簡略化することができます。また、新しい規格や独自のシリアル・プロトコルもサポートします。
HardCopy ASIC のトランシーバの主な特長
- 最大 36個のトランシーバは 600 MHz ～ 10.3 Gbps のデータ・レートをサポートします。
- ダイナミックにプログラム可能な差動出力電圧(VOD)およびプリエンファシスがシグナル・インテグリティを向上
- 物理媒体での周波数依存損失を補償するための、最大 17dB のゲインを有するユーザー制御可能 またはアダプティブな 4 ステージ・レシーバ・イコライゼーション機能
- PCI Express Gen1 および Gen2、Serial RapidIO®、ギガビット・イーサネット（GbE）、XAUI/HiGig、OIF（Optical Internetworking Forum） CEI-6G、Interlaken、SFI-5、GPON、SONET、CPRI、OBSAI、ファイバ・チャネル、HyperTransport™、SDI、およびアルテラの SerialLite II などに限らず、 CDR ベースのシリアル規格をサポート
- ユーザー独自のプロトコルを実装するシングル幅およびダブル幅の Basic モードをサポート
- 個々のトランスミッタ／レシーバにおいて非動作時に消費電力を低減するためのパワーダウン機能
- 多様な伝送媒体でシグナル・インテグリティを改善するセレクタブルな On-Chip Termination（チップ内終端）
- 選択可能な 8、10、16、20、32、40 ビット幅のデータ転送をサポートするトランシーバ‐コア間のインタフェース
- 信号損失を示すレシーバ・インジケータ
- ビルトイン・セルフ・テスト(BIST)
- ホット・ソケット保護回路によるプラグ & プレイ・シグナル・インテグリティ
- 同一チャネル上で複数のプロトコルおよびデータ・レートをサポートする、トランシーバのダイナミック・リコンフィギュレーション機能
- 2個の PLL（Phase-Locked Loop）および独立したクロック・ディバイダを搭載し、チャネルごとに異なるクロック・レートを提供
- Basic モード用の一般的な極性変換および PCI Express 用の極性変換
- プログラマブル・パターンをサポートするレート・マッチャ、パターン検出、およびワード・アライナ
- PCI Express（PIPE）、XAUI、および GbE の物理インタフェースに準拠した専用回路
- 内蔵の PCI Express Gen1 (2.5 Gbps) および Gen2(5.0 Gbps) 対応 ハード IP またはソフト IP を直結する PIPE インタフェース
- フレームまたはパケットが常に既知のバイト・レーンで開始するためのビルトイン・バイト・オーダリング
- 8 ビットから 10 ビットへのエンコーディングおよび 10 ビットから 8 ビットへのデコーディングを実行する 8B/10B エンコーダ/デコーダ
- 受信データをローカル基準クロックに再同期させるためのレシーバ・レート・マッチャ FIFO バッファ
- トランシーバ・ブロックとロジック・アレイ間のクロック・ドメイン変換を行う位相補償 FIFO バッファ
ブロック図
図 1 に、Stratix IV GX FPGA と HardCopy IV GX ASIC のトランシーバ、フィジカル・メディア・アタッチメント（PMA）およびフィジカル・コーディング・サブレイヤ（PCS）のブロック図を示します。PCS 内のブロックは、ユーザーの必要条件に応じてバイパスすることが可能です。
図 1. HardCopy IV トランシーバと Stratix IV (GX および GT) トランシーバ、PMA および PCS のブロック図
HardCopy IV GX トランシーバは、600 Mbps ～ 10.3 Gbps で動作する、標準プロトコルおよび独自プロトコルを実装するために専用回路を提供します。これらのトランシーバは、オーバサンプリングを使用して 270 Mbps のような低いデータ・レートもサポートします。これはレガシー・プロトコルや複数のデータ・レートを持つプロトコルをサポートする場合に重要です。アルテラの IP（Intellectual Property）と統合することで、HardCopy IV ASIC と Stratix IV FPGA (GX および GT) トランシーバは、シリアル・プロトコル実装のための完全かつ低リスクなソリューションを提供します。
