アルテラ、Quartus II 開発ソフトウェア v8.0をリリース
40nmの新製品群をサポート

プログラマブル・ロジック・ソリューションの世界的リーディング・カンパニーであるアルテラ・コーポレーション（本社：米国カリフォルニア州サンノゼ、社長兼CEO：ジョン・デイナ、日本法人：東京都新宿区、代表取締役社長：日隈寛和、NASDAQ：ALTR　以下、アルテラ）は米国時間5月19日（日本時間：5月20日）、同社の40nm Stratix® IV FPGAとHardCopy® ASICをサポートする開発ソフトウェア「Quartus® II 開発ソフトウェア v8.0」（以下、Quartus II v8.0）を発表しました。

FPGA設計者に“最高水準の性能と生産性を提供する”というお客様へのコミットメントに基づき、アルテラはこれまでも開発ソフトウェアの性能と生産性において業界をリードしてきました。生産性をさらに向上させる機能を追加した業界最先端のFPGAをサポートする「Quartus II　開発ソフトウェア v8.0」は、最も近い競合他社の最新製品に比べて、平均で2スピード・グレード優れた性能差、およびハイエンドFPGAの設計において1/3のコンパイル時間を実現します。（同時発表のアルテラの40nmデバイスに関連するニュースリリース（日本語：www.altera.co.jp/corporate/news_room/releases/products/nr-stratix-iv-hardcopy-iv.html）を参照ください）

業界最速のコンパイル時間　～　年平均20%以上の高速化

Quartus II 開発ソフトウェアは、過去5年間連続で、ハイエンドFPGAの設計において業界最速のコンパイル時間を実現しており、年平均20％のコンパイル時間の短縮に成功してきました。Windowsプラットフォーム上でアルテラの65nm Stratix III FPGAを設計する場合、Quartus II v8.0はv7.2に比べて、コンパイル時間を平均22％、最大50％短縮可能です。Linuxプラットフォームでの設計の場合は、平均で30％以上コンパイル時間を短縮できます。また、アルテラはマルチプロセッサをサポートする業界で唯一のFPGAベンダであり、マルチプロセッサ搭載サーバーでの設計の場合、平均でさらに20％コンパイル時間が短縮可能です。

設計生産性の大幅な向上を実現　 ～「インクリメンタル・コンパイル機能」と「デザイン・パーティション・プランナ」

Quartus II 開発ソフトウェアの「インクリメンタル・コンパイル機能」は、設計生産性の大幅な向上を実現し、 一般的なコンパイル機能に比べて、コンパイル時間を最大70％短縮することができます。Quartus II　v8.0では、このインクリメンタル・コンパイル機能を最大限に活かすツールとして、新たにグラフィカル・ツール「デザイン・パーティション・プランナ」を追加しました。これにより、インクリメンタル・コンパイル機能を実行する過程でデザイン・パーティションを作成する際、インタラクティブなグラフィカル・ユーザー・インタフェース（GUI）で、ロジック・リソースの使用状況、パーティション間のタイミング・パスなどについて、リアルタイムに結果を得ることができるため、最も効率的なパーティションの検討および迅速な決定が可能となります。

アルテラのソフトウェア、エンベデッド、およびDSP担当マーケティング・ディレクタのクリス・バロー（Chris Balough）は、「当社の顧客企業は、厳しい競争環境下で製品をいかに早く市場へ投入するかという課題に日々直面しています。その中で、FPGAを用いた設計で実現できる生産性の向上が注目されており、本日発表したQuartus II 開発ソフトウェア v8.0は、業界最先端となる40nm FPGAの設計を実現し、生産性のさらなる向上を実現させるものであり、顧客からの信頼をさらに強固にするものであると確信しています」と述べています。

Quartus II 開発ソフトウェア v8.0の拡張機能概要

• 新しくなったタスク・ウィンドウ
  FPGAデザイン・フローに沿ってユーザーを導く、インタラクティブなデザイン・フロー・コンソールを提供します。
• SOPC Builderの機能拡張とデザイン・ライブラリの拡充
  インクリメンタル・コンパイル機能をサポートし、デザイン・ライブラリにJTAGやSPIインターフェースなど、重要なIPブロックを追加しました。
• ピン・プランナに「ピン・スワッピング機能」追加
  ピン･プランナにピン・スワッピング機能を追加しました。これにより、FPGAのI/Oプランニングをより容易にし、その結果、ボードの開発期間が短縮されます。
• IPアドバイザの新規追加
  新しくIPアドバイザ機能を追加しました。特定デザイン向けのガイドラインや、アルテラのPCI Express、およびDDR3メモリコントローラIPの使用例を提供します。
• MegaCore® IPライブラリを拡充
  MegaCore IPライブラリをQuartus II 開発ソフトウェアに統合することで、アルテラのIPコア製品群の利便性が向上しています。今回新たに追加されたIPコアとしては、「PCI Express Gen2」ハードIP、5つの新しいビデオ/画像処理コアがあり、さらに多くの機能拡張も行われています。
• メガファンクションの拡充
  新しく追加された浮動小数点ファンクション、DLL（Delay Locked Loop）、およびメモリ初期化のメガファンクションにより、デザイン開発期間の短縮に貢献します。

 Quartus II 開発ソフトウェア v8.0で提供される機能の詳細情報は、アルテラのWebサイト（www.altera.com/q2whatsnew　日本語：www.altera.co.jp/q2whatsnew）をご覧ください。

価格と出荷時期

Quartus II　開発ソフトウェア v8.0のサブスクリプション・エディションのライセンスは、「アルテラ・ソフトウェア・サブスクリプション契約」により、アルテラの販売代理店を通じて購入可能です。米国時間6月2日（日本時間：6月3日）には、Quartus II　v8.0のサブスクリプション・エディションおよびWebエディションともに、www.altera.com/download（日本語： www.altera.co.jp/download）からダウンロード可能となります。 「アルテラ・ソフトウェア・サブスクリプション契約」は、1年間のサブスクリプション費用にソフトウェアとメンテナンス費を含み、常に最新版をご使用いただけます。「アルテラ・ソフトウェア・サブスクリプション契約」には、Quartus II 開発ソフトウェアのサブスクリプション・エディションだけでなく、Mentor Graphics® の「ModelSim® アルテラ版」、アルテラのIPコアで最もよく利用されている11個のIPコア（DSPとメモリ・コア）で構成されている「IP Base Suite」の全ライセンスが含まれています。年間費用は、米国内販売価格2,495ドル（ノード・ロックPCライセンス時）で、アルテラの販売代理店からご購入いただけます。

アルテラ・コーポレーションについて

アルテラ・コーポレーションは、プログラマブル・ロジック・ソリューションの世界的リーディング・カンパニーです。1983年にシリコンバレーで創業した世界で最初のファブレス企業であり、1988年にNASDAQに上場しました。PLD、FPGA/CPLD、ASICなど、カスタム・ロジックの分野におけるテクノロジー・リーダーとして高成長を続け、顧客企業のイノベーションに貢献しています。世界各国に拠点を持ち、日本法人である日本アルテラ株式会社は1990年に設立されました。顧客志向のソリューションが高く評価され、日本におけるPLD市場でトップシェアを維持しています。

http://www.altera.com　
http://www.altera.co.jp (日本語）

Altera、The Programmable Solutions Company、アルテラのロゴ、弊社特定デバイスの定義、およびその他の商標ならびにサービス・マークを意味する語彙は、特記されていない限り、すべてアルテラ・コーポレーションの米国及びその他の国における登録商標、商標または　サービス・マークです。その他記載されている製品名あるいはサービス名は各所有企業に帰属します。　

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